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工作職責:
1、設計DDR PHY中的高速模擬電路（如DDR I/O、PLL、DLL、均衡器EQ）。
2、優(yōu)化接收端（RX）與發(fā)送端（TX）的SI/PI性能（如抗抖動、眼圖裕量）。
3、指導版圖設計，確保匹配性（八邊形法則）及抗ESD能力。
4、支持硅片特性測試（Shmoo Plot）及良率提升。
任職資格:
崗位要求：
1、8年及以上模擬IC設計經(jīng)驗，精通Cadence Virtuoso/Spectre。
2、深入理解高速電路設計（如差分信號、阻抗匹配、噪聲抑制）。
3、掌握DDR接口的SI/PI分析方法及工藝模型（FinFET優(yōu)先）。
4、有DDR4/5或HBM PHY設計經(jīng)驗者優(yōu)先。